28335上FOC实时性设计：PWM死区、电流采样与IQ定点的毫秒级协同

简介：本资源是一套基于TMS320F28335 DSP芯片实现电机磁场定向控制（FOC）与空间矢量脉宽调制（SVPWM）的完整嵌入式控制工程，面向电力电子、电机控制方向的本科生、研究生及工业自动化工程师，解决永磁同步电机（PMSM）高精度实时控制的开发入门与工程落地难题。压缩包共135个文件，涵盖33个头文件（h）、25个源码文件（c）、19个目标文件（obj）及关键启动代码（如DSP2833x_CodeStartBranch.asm）、中断服务程序（DSP2833x_SWPrioritizedDefaultIsr.c）、主控逻辑（Main.c）和外设驱动模块，全面支撑FOC坐标变换、PI电流环设计、SVPWM生成等核心功能实现；整体大小仅1.25MB，结构紧凑、可直接编译运行。已有2214人学习下载，提供从底层寄存器配置、ADC采样、PWM输出到闭环控制算法的全链路代码支撑，特别适合初学者理解FOC在C28x浮点平台上的工程化部署细节，并可作为二次开发与参数整定的可靠基准。

1. FOC不是“加个PI就转起来”：28335上电机失控的真相，藏在PWM死区与电流采样相位偏移的毫秒级博弈里

你调通了SVPWM，接上了编码器，PID参数调得飞起，电机却一上电就抖动、低速爬行无力、高速时力矩突降——这不是硬件坏了，也不是代码有bug，而是FOC在28335这颗定点DSP上，从底层时序开始就处于“亚稳态”。很多人以为FOC是算法问题，其实它首先是个实时系统工程问题：28335主频150MHz，但ADC采样、PWM更新、Clarke/Park变换、PI调节、SVPWM生成，全挤在单个PWM周期（比如20kHz对应50μs）内完成；而其中任意一个环节的微小相位错位——比如电流采样点落在PWM高电平中间而非下桥臂导通稳定后，或Park反变换输出的Vd/Vq没对齐下一个PWM周期的电压矢量作用窗口——都会让整个磁场定向“失准”，最终表现为转矩脉动、效率骤降、甚至过流保护。这份基于28335的FOC控制资源，不是一份“能跑”的例程，而是一套把28335的ePWM模块、ADC SOC触发链、IQMath定点库、中断嵌套优先级全部拧紧到机械共振频率以下的硬实时校准方案。它解决的不是“怎么实现FOC”，而是“为什么在28335上FOC必须这样实现”。

2. 28335的FOC不是移植算法，而是重写时序：ePWM+ADC+CPU三者间的纳秒级协同机制

FOC在通用MCU上可以靠软件延时或粗粒度定时器凑合，在28335上不行。它的核心矛盾在于：磁场定向要求电流采样严格对齐PWM中点（即定子电压矢量实际作用时刻），而28335的ADC转换本身需要时间，且ePWM的事件触发与ADC启动存在固有延迟。这份资源的底层设计，正是围绕这个物理约束展开的。

2.1 ePWM模块的“双触发”死区配置：为什么必须用CTR=PRD和CTR=0双中断源

28335的ePWM模块支持多种中断触发方式，但FOC只信任一种组合：在计数器等于周期寄存器（CTR = PRD）时触发ADC SOC（Start of Conversion），同时在CTR = 0时触发FOC主计算中断。原因很直接：

• CTR = PRD 对应PWM周期结束、下一周期开始的瞬间，此时上下桥臂均关断（死区结束），下桥臂已稳定导通，是电流采样的黄金窗口；
• 若仅用CTR = PRD中断做全部计算，ADC转换完成中断（EOC）到来时，CPU可能正忙于其他任务，导致采样值读取延迟，破坏相位一致性；
• 因此，CTR = PRD仅用于无延迟触发ADC，而CTR = 0中断（即新PWM周期起点）才执行Clarke变换、Park变换、PI调节、反Park、SVPWM占空比更新——所有这些操作必须在下一个CTR = PRD到来前完成，否则采样就错相了一个周期。

// 关键配置：ePWM1配置为UP-DOWN模式，PRD=750（对应20kHz） EPwm1Regs.TBPRD = 750; // 周期寄存器 EPwm1Regs.TBCTL.bit.CTRMODE = TB_COUNT_UPDOWN; // 计数模式 EPwm1Regs.ETSEL.bit.SOCAEN = 1; // 使能SOC A触发 EPwm1Regs.ETSEL.bit.SOCASEL = ET_CTR_PRD; // SOC A在CTR=PRD时触发 EPwm1Regs.ETPS.bit.SOCAPRD = 1; // 每次CTR=PRD都触发SOC EPwm1Regs.ETSEL.bit.INTEN = 1; // 使能CTR=0中断 EPwm1Regs.ETSEL.bit.INTSEL = ET_CTR_ZERO; // 中断在CTR=0时发生

提示：SOCASEL = ET_CTR_PRD是硬性要求，不能设为ET_CTR_CMPA或ET_CTR_CMPC——后者会因CMP寄存器动态修改引入抖动，破坏采样时刻稳定性。

2.2 ADC SOC链的“零等待”调度：如何让采样结果在中断到来前就躺在寄存器里

28335的ADC有16个通道，但FOC只需采样两相电流（通常Ia、Ib）。关键不在“采哪两路”，而在“何时把它们塞进CPU手里”。这份资源采用双SOC流水线+ADCINT1中断绑定策略：

• SOC0触发Ia采样，SOC1触发Ib采样，两者由同一ePWM事件（CTR=PRD）串行启动；
• ADC转换时间固定为13.84个ADCCLK（假设ADCCLK=25MHz → 单次转换≈554ns）；
• 所有ADC通道配置为ACQPS = 0（零采样保持时间），因为电流信号变化缓慢，且重点在相位而非幅值精度；
• ADCINT1中断被绑定到SOC1的EOC（End of Conversion），确保Ib采样完成时立即响应——此时Ia早已转换完毕，数据就在AdcRegs.ADCRESULT0中静候。

// ADC初始化关键段：SOC0/SOC1由ePWM1触发，顺序执行 AdcRegs.ADCTRL2.bit.EPWM_SOCA_SEQ1 = 1; // EPWM1 SOC A触发SEQ1 AdcRegs.ADCMAXCONV.bit.MAX_CONV1 = 1; // SEQ1含2个通道 AdcRegs.ADCCHSELSEQ1.bit.CONV00 = 0x0; // SOC0 -> CH0 (Ia) AdcRegs.ADCCHSELSEQ1.bit.CONV01 = 0x1; // SOC1 -> CH1 (Ib) AdcRegs.ADCTRL1.bit.SEQINTCOD = 0x1; // EOC of SOC1 triggers ADCINT1 PieVectTable.ADCINT1 = &adc_isr; // 绑定中断服务函数

逻辑说明：ADCTRL2.bit.EPWM_SOCA_SEQ1 = 1表示ePWM1的SOC A事件将启动SEQ1序列；ADCCHSELSEQ1定义了该序列先采CH0再采CH1；ADCTRL1.bit.SEQINTCOD = 0x1确保只有SOC1（即Ib）转换完成才发中断。这样，当中断进入adc_isr时，ADCRESULT0（Ia）和ADCRESULT1（Ib）两个寄存器均已有效，无需轮询等待，省下至少2~3μs——这对50μs周期而言，就是6%的计算裕量。

2.3 CPU负载的“呼吸感”分配：为什么FOC主循环必须拆成两级中断

若把所有FOC运算（Clarke→Park→PI→反Park→SVPWM）塞进CTR=0中断，28335在20kHz下会严重超时。实测表明：单次完整FOC计算（含IQMath定点运算）需约18~22μs，而留给CTR=0中断的窗口仅从CTR=0到下一个CTR=PRD（即25μs），余量不足。本资源采用主中断（CTR=0）只做轻量任务 + 高优先级子中断（ADCINT1）承接重载的分层策略：

• CTR=0中断：仅更新ePWM比较寄存器（CMPA/CMPB）、清标志、喂看门狗；
• ADCINT1中断（更高优先级）：执行全部数学运算，结果存入全局变量Vd_ref,Vq_ref；
• 主循环（while(1)）仅做非实时任务：参数上位机通信、故障诊断、LED状态刷新。

这种拆分的本质，是把最耗时的定点三角函数（sin/cos）、除法（Park反变换中的Id/Iq归一化）、矩阵乘法（Clarke）全部移到ADC采样完成后的“确定性窗口”执行，避免与PWM时序强耦合。而CTR=0中断则回归其本质：一个精准的“电压矢量切换开关”。

注意：必须在PIE控制器中将ADCINT1优先级设为高于EPWM1_INT，否则ADC中断会被PWM中断抢占，导致计算延迟不可控。

3. 定点运算不是“float改IQ”：IQMath库在28335上的溢出陷阱与缩放因子推演

28335没有FPU，FOC中所有sin/cos、除法、开方、Park变换都依赖TI提供的IQMath库。但直接把浮点公式套用IQ类型，90%会翻车——不是结果不准，而是中间过程溢出后符号反转，电机直接反转或锁死。这份资源的IQ缩放设计，是经过实测电流环带宽（1kHz）、母线电压（310V）、相电阻（0.5Ω）反向推导出的。

3.1 Park变换的IQ缩放：为什么Id_ref必须用IQ24，而Vd_ref只能用IQ20

Park正变换公式为：

Id = Iα·cosθ + Iβ·sinθ Iq = -Iα·sinθ + Iβ·cosθ

其中Iα、Iβ来自ADC采样（12位，满幅3.3V，经运放调理后对应±30A → 量化步长≈1.46mA），θ来自编码器（QEP模块输出，2^16分辨率）。若统一用IQ24表示所有变量：

• Iα, Iβ最大值≈±2047（12位有符号）→ IQ24表示为 ±2047 << 24 ≈ ±3.5e10，远超32位有符号整数上限（2^31-1≈2.1e9）；
• cosθ/sinθ范围[-1,1]，用IQ24表示即 [-2^24, 2^24)，乘积Iα·cosθ最大绝对值达 2047 × 2^24 ≈ 3.5e10 → 必然溢出。

因此，资源中采用分级缩放：

• 电流采样值存为IQ24（保留高分辨率，供后续PI积分累加）；
• 角度θ存为IQ28（保证sin/cos查表精度）；
• cosθ/sinθ查表输出为IQ15（即[-1,1)映射到[-32768,32767]）；
• Park输出Id/Iq强制截断为IQ20（即数值范围±524288），因为PI调节器输出限幅设为±0.8（物理意义：最大直轴/交轴电压占比），对应IQ20即 ±0.8 × 2^20 ≈ ±838860。

// IQMath关键缩放声明（来自resource_iq.h） #define GLOBAL_Q 24 // 全局基础Q值（电流、位置） #define ANGLE_Q 28 // 角度专用Q值（高精度） #define SIN_COS_Q 15 // sin/cos表输出Q值（平衡精度与范围） #define VOLTAGE_Q 20 // 电压指令Q值（匹配PWM占空比范围） // Park正变换调用（实际代码） Id = _IQmpy(Ialpha, _IQcos(theta)) + _IQmpy(Ibeta, _IQsin(theta)); // 返回IQ20 Iq = _IQmpy(_IQneg(Ialpha), _IQsin(theta)) + _IQmpy(Ibeta, _IQcos(theta));

_IQmpy是IQMath的定点乘法宏，内部自动处理Q值对齐与饱和。此处Ialpha（IQ24）与_IQcos(theta)（IQ15）相乘，结果默认为IQ(24+15)=IQ39，但宏会右移19位（39-20）并饱和，最终输出IQ20——这就是缩放因子的物理意义：它不是随意选的，而是由ADC分辨率、母线电压、期望控制带宽共同决定的系统级约束。

3.2 PI调节器的“防积分饱与”实现：为什么不用if-else限幅，而用IQsat

传统PI代码常写：

error = Iq_ref - Iq_fb; integral += Ki * error; output = Kp * error + integral; if(output > OUT_MAX) output = OUT_MAX; if(output < OUT_MIN) output = OUT_MIN;

在IQMath中，这会导致严重问题：Ki * error可能产生巨大中间值，integral累加后超出IQ范围，发生符号错误。本资源采用TI推荐的IQsat饱和宏+积分分离式结构：

// 积分分离式PI（抗饱和） if(abs(Iq_error) < _IQ(0.05)) { // 误差小于5%时启用积分 integral = _IQsat(integral + _IQmpy(Ki, Iq_error), _IQ(0.8), _IQ(-0.8)); } else { integral = _IQ(0); // 大误差时冻结积分 } Iq_out = _IQmpy(Kp, Iq_error) + integral; Iq_out = _IQsat(Iq_out, _IQ(0.8), _IQ(-0.8)); // 输出饱和

_IQsat(val, max, min)是硬件级饱和指令（编译为SACH/SACL），单周期完成，无分支预测失败开销。更重要的是，它在累加前就对Ki*error做饱和，避免积分项爆炸。实测表明，未加积分分离时，电机突加负载易出现“反向制动”现象——正是积分饱和后符号反转所致。

3.3 SVPWM占空比生成的Q值陷阱：为什么CMPA必须用IQ15而非IQ20

SVPWM输出的是三相占空比Ta, Tb, Tc，范围[0,1]，最终写入ePWM的CMPA寄存器（16位无符号）。若Ta用IQ20表示（即0~1映射为0~2^20），则需右移4位才能填入16位CMPA寄存器，但右移会损失精度；若直接用IQ15（0~1→0~32767），则左移1位即可得0~65534，完美覆盖CMPA范围（0~65535）。

// SVPWM输出到CMPA的映射（关键！） Ta_iq15 = _IQtoIQ15(Ta); // Ta∈[0,1] → Ta_iq15∈[0,32767] Tb_iq15 = _IQtoIQ15(Tb); Tc_iq15 = _IQtoIQ15(Tc); // 写入ePWM（CMPA为16位，需0~65535） EPwm1Regs.CMPA.half.CMPA = (Uint16)(Ta_iq15 << 1); // 左移1位 EPwm1Regs.CMPB.half.CMPB = (Uint16)(Tb_iq15 << 1);

提示：_IQtoIQ15宏内部执行val >> (GLOBAL_Q - 15)，若GLOBAL_Q=24，则右移9位，再截断。这步缩放必须在SVPWM算法输出后立即进行，否则后续运算会因Q值不匹配导致比例失调。

4. 避坑：28335 FOC调试中最痛的5个“玄学”问题与硬核解法

FOC在28335上不是调不通，而是“看起来通了，一加载负载就崩”。这些问题往往不报错、不进fault中断，只表现为力矩脉动、转速跳变、母线电流尖峰——全是时序与缩放的隐性bug。以下是实测踩出的血泪经验：

4.1 现象：电机低速（<100RPM）严重抖动，高速反而平稳

原因：编码器QEP模块的滤波设置不当。28335 QEP有QCAPCTL寄存器可设采样时钟分频，若设为QCAPCTL[15:13]=000（不分频），高频噪声会误触发边沿，导致θ计算跳变；低速时边沿间隔长，噪声占比高，影响更甚。
解决：将QEP输入时钟分频设为8（QCAPCTL[15:13]=011），并开启数字滤波（QDECCTL[7]=1），实测可消除95%低速抖动。

4.2 现象：空载运行正常，一加负载电流环就震荡，Iq_fb剧烈波动

原因：电流采样运放的相位补偿缺失。FOC要求采样信号相位滞后≤1μs，但普通RC滤波（如10k+1nF）在10kHz处相移已达45°，导致Park变换输入Iα/Iβ相位失准。
解决：改用有源二阶贝塞尔滤波（TLV2372搭建），截止频率设为25kHz，群延迟恒定≈0.8μs；或直接取消硬件滤波，靠ADC过采样+软件移动平均（本资源采用后者：4点滑动平均，延迟1.5μs，可接受）。

4.3 现象：电机启动时偶尔反转，或堵转后无法恢复

原因：初始角度估算错误。28335无霍尔，依赖高频注入或开环启动。本资源用开环启动：先施加固定θ ramp，待Iq建立后切闭环。若ramp斜率过大（如1000rpm/s），转子跟不上磁场，θ估计偏差超π/2，Park反变换输出负电压，导致反转。
解决：启动ramp斜率限制为200rpm/s，并加入“Iq建立确认”逻辑：连续5个周期Iq_fb > 0.1pu才切闭环，避免误判。

4.4 现象：母线电压升高后，相同给定转速下力矩下降

原因：SVPWM的Vdc基准未随母线电压动态更新。Park反变换输出Vd/Vq是电压指令，需除以Vdc归一化为占空比。若Vdc采样值（ADC_CH2）未校准或未实时更新，Vdc升高时占空比计算值偏小，实际输出电压不足。
解决：每100ms用ADC采样一次Vdc，通过查表法校准（本资源提供Vdc_ADC值→真实电压的16点校准表），并缓存至全局变量Vdc_real，SVPWM中强制使用Vdc_real而非固定值。

4.5 现象：多电机并联时，某台电机周期性过流保护

原因：ePWM模块的同步信号（SYNCO）未正确配置。28335支持多ePWM同步，若EPWM1为主，EPWM2/3为从，但TBCTL[11]=0（未使能phase load），则从模块相位漂移，导致电流采样不同步，Park变换参考系错乱。
解决：主ePWM（EPWM1）设TBCTL[11]=1（使能SYNCI输入），从ePWM（EPWM2）设TBCTL[10]=1（使能SYNCO输出），并连接SYNC引脚；所有ePWM的TBPHS寄存器清零，确保相位严格对齐。

5. 死区时间不是“越大越安全”：28335上死区与电流采样的相位博弈验证法

死区时间（Dead Time）常被当作“保命参数”盲目加大，但28335的FOC实践揭示一个反直觉事实：死区过大，比死区过小更易导致转矩脉动。根本原因在于——死区改变了电流采样的物理窗口。这份资源提供了一套可复现的验证方法，不依赖示波器，仅用逻辑分析仪+GPIO打点，就能定位死区与采样的相位关系。

5.1 死区对电流采样窗口的物理切割

以两电平逆变器为例，理想电流采样点应在下桥臂完全导通、上桥臂完全关断的稳定期。但加入死区后，上下桥臂关断期间存在“悬浮”状态，此时电流路径不确定（续流二极管或IGBT体二极管导通），采样值失真。28335的ePWM死区模块（DBTCON）允许独立设置上升沿/下降沿死区，关键参数是DBTCON[10:0]（死区计数器值）。假设PWM周期50μs，死区设为1μs，则：

• 下桥臂导通起始点被推迟1μs；
• 上桥臂关断终点被推迟1μs；
• 实际“稳定导通窗口”从原50μs缩短为48μs，且中心偏移。

若ADC SOC仍按CTR=PRD触发（即原50μs终点），则采样点实际落在死区结束后的1μs处——看似安全，但此时电流可能刚从二极管换流到IGBT，存在100ns级振荡，ADC采样值包含高频噪声。

5.2 GPIO打点法：用肉眼“看见”死区与采样的时序差

本资源在adc_isr入口和出口各置一个GPIO翻转（如GPIO0），同时在ePWM的CTR=PRD事件处也置GPIO翻转（GPIO1）。用逻辑分析仪捕获这两路信号：

• GPIO1高电平宽度 = ePWM死区时间（理论值）；
• GPIO0上升沿到GPIO1下降沿的时间差 = SOC触发到ADC中断的实际延迟；
• 若该差值 < 2μs，说明采样发生在死区刚结束的不稳定区；理想值应为3~5μs（留出器件开关时间）。

实测数据（28335@150MHz，死区设为1.2μs）：

结论：最佳死区不是理论最小值，而是让GPIO0-GPIO1延迟落在3.0~4.0μs区间的值。这需要结合IGBT型号（如IRGP4062DPBF的td(off)=120ns）和驱动电路（光耦延迟≈0.3μs）综合计算。

5.3 动态死区补偿：当温度升高时，如何不让死区“失效”

IGBT的关断时间随结温升高而延长（125℃时td(off)比25℃长约40%）。若死区固定，高温下可能出现“直通”风险；若按高温设死区，常温下又牺牲效率。本资源采用温度查表+死区动态调整：

• 用NTC采集散热器温度（ADC_CH3）；
• 查16点温度-td(off)表（已内置于Flash）；
• 实时计算所需死区 = td(off)_max + 驱动延迟 + 余量（0.2μs）；
• 更新DBTCON寄存器（需在ePWM停止时修改，故在CTR=0中断中判断温度变化后，置flag，下个周期停PWM再更新）。

// 温度查表伪代码（实际为const Uint16 temp_td_table[16]） Uint16 temp_code = AdcRegs.ADCRESULT3 >> 4; // 12位ADC取高8位 Uint16 td_off_us = temp_td_table[temp_code >> 4]; // 16点查表 Uint16 dbt_val = (Uint16)((td_off_us + 0.5) * 125); // 转为DBTCON值（125MHz时钟） if(dbt_val != current_dbt) { dbt_update_flag = 1; // 标记需更新死区 } // 在CTR=0中断中： if(dbt_update_flag) { EPwm1Regs.TBCTL.bit.PHSEN = 0; // 禁用相位加载 EPwm1Regs.DBTCON.all = dbt_val; current_dbt = dbt_val; dbt_update_flag = 0; }

注意：DBTCON修改必须在ePWM计数器为0或停止时进行，否则可能触发不可预知行为。本资源通过TBCTL.bit.PHSEN=0临时禁用相位同步，安全写入。

6. 从那以后我每次部署28335 FOC，都强制走一遍“三相打点验证法”

所谓“三相打点”，不是指测三相电压，而是用三个GPIO分别标记FOC流程中最脆弱的三个相位点：

• GPIO0：ePWM CTR=PRD事件（电流采样触发点）；
• GPIO1：ADCINT1中断入口（FOC计算起点）；
• GPIO2：CTR=0中断中更新CMPA的时刻（电压矢量切换点）。

用逻辑分析仪抓这三路信号，直接测量：

1. GPIO0 → GPIO1 延迟：验证ADC转换是否在预期时间内完成（应<2.5μs）；
2. GPIO1 → GPIO2 延迟：验证FOC计算是否在25μs内完成（应<22μs）；
3. GPIO2 → 下一个GPIO0 延迟：验证ePWM周期是否严格锁定（应=50.000±0.05μs）。

这三组数据，比任何仿真波形都真实。我曾在一个风电变流器项目中，发现GPIO0→GPIO1延迟忽高忽低（1.8μs~3.2μs），排查三天无果，最后发现是ADC电源滤波电容虚焊——纹波导致ADCCLK抖动。没有这三路打点，这个问题会一直被归因为“软件不稳定”。

更关键的是，这套方法让我彻底抛弃了“先调通再优化”的惯性。现在，只要三相打点时间差超出阈值，我就知道：要么死区没配对，要么IQ缩放溢出了，要么中断优先级错了——问题域被压缩到3个硬件信号之间，而不是在万行代码里盲搜。

这份基于28335的FOC资源，真正的价值不在它提供了多少行代码，而在于它把28335这颗芯片的物理极限（时钟抖动、ADC孔径延迟、ePWM死区精度）和FOC的数学要求（相位对齐、缩放一致性、实时性）焊死在了一起。它不是一个“能用”的方案，而是一个“必须这么用”的铁律。希望帮到你。

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